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Downs

浅谈CMOS模拟集成电路版图设计的器件匹配方法

百度网盘下载:http://pan.baidu.com/share/link?shareid=21072308 […]

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Layout

每一个电路都可以做的很完美,对应的版图也可以画的很艺术,需要的是耐心和细心,当然也要有时间,至少我这么认为。

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EDA

cadence virtuoso 非正常关闭后layout数据恢复

大清早的该死的virtuoso莫名其妙连续关闭两次,打的好几十label没保存就没了,郁闷不已。所以尝试一下c […]

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Layout

关于IC版图中的匹配规则

在以前的三篇文章《IC layout中CMOS晶体管匹配基础篇》,《 IC版图设计中电阻的匹配基础篇》,《 I […]

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Layout

IC版图设计中电容的基本匹配规则

对于IC layout工程师来说正确地构造电容能够达到其它任何集成元件所不能达到的匹配程度。下面是一些IC版图 […]

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IC版图设计中电阻的匹配基础篇

在IC版图(layout)的设计中,作为无源器件的电阻,其匹配也是很重要的,一个优秀的IC版图工程师将会遵守更 […]

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Layout

晶体管版图的画法对其电阻的影响

我们都知道在CMOS工艺中的晶体管由源极(active),栅极(poly-silicon) 和漏极(activ […]

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Layout

ic layout设计中的几种功率管(power mos)版图

简单提一下几种power mos的 layout 画法,并简要说明其优缺点。

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Layout

match of layout(版图中的匹配)

  主要工作注意事项 一.画之前的准备工作 1.先估算芯片面积:先分别计算各个电路模块的面积,然后再 […]